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A Multi Synchronization Shared Buffer ATM Switch to relieve Multistage System High-Speed Clock Difficulty in VLSI
https://kougei.repo.nii.ac.jp/records/438
https://kougei.repo.nii.ac.jp/records/438ccdead51-e220-4738-b9c8-60fa4131172b
| 名前 / ファイル | ライセンス | アクション |
|---|---|---|
vol1-29-13.pdf (1.3 MB)
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| Item type | [ELS]紀要論文 / Departmental Bulletin Paper(1) | |||||
|---|---|---|---|---|---|---|
| 公開日 | 2017-04-21 | |||||
| タイトル | ||||||
| タイトル | A Multi Synchronization Shared Buffer ATM Switch to relieve Multistage System High-Speed Clock Difficulty in VLSI | |||||
| 言語 | en | |||||
| 言語 | ||||||
| 言語 | eng | |||||
| 資源タイプ | ||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_6501 | |||||
| 資源タイプ | departmental bulletin paper | |||||
| 雑誌書誌ID | ||||||
| 収録物識別子タイプ | NCID | |||||
| 収録物識別子 | AN00159741 | |||||
| 論文名よみ | ||||||
| タイトル | A Multi Synchronization Shared Buffer ATM Switch to relieve Multistage System High-Speed Clock Difficulty in VLSI | |||||
| 著者 |
藤橋, 忠悟
× 藤橋, 忠悟× 行谷, 時男× Fujihashi, Chugo× Yukiya, Tokio |
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| 著者所属(英) | ||||||
| en | ||||||
| Department of Applied Computer Science, Faculty of Engineering, Tokyo Polytechnic University | ||||||
| 著者所属(英) | ||||||
| en | ||||||
| Department of Applied Computer Science, Faculty of Engineering, Tokyo Polytechnic University | ||||||
| 記事種別(日) | ||||||
| 内容記述タイプ | Other | |||||
| 内容記述 | 論文 | |||||
| 記事種別(英) | ||||||
| 内容記述タイプ | Other | |||||
| 内容記述 | Article | |||||
| 書誌情報 |
東京工芸大学工学部紀要 en : The Academic Reports, the Faculty of Engineering, Tokyo Polytechnic University 巻 29, 号 1, p. 107-116, 発行日 2006 |
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| 表示順 | ||||||
| 内容記述タイプ | Other | |||||
| 内容記述 | 13 | |||||
| アクセション番号 | ||||||
| 内容記述タイプ | Other | |||||
| 内容記述 | KJ00004551562 | |||||
| ISSN | ||||||
| 収録物識別子タイプ | ISSN | |||||
| 収録物識別子 | 03876055 | |||||
